V3学院杯:全可编程SoC嵌入式系统设计大赛
时间：2017年06月19日 15:00
简介：Zynq7000系列开发板面向机器视觉方向，传统的软件工程师、系统架构工程师、以及深度学习的视觉算法爱好者，可以适用软件定义的概念(SDSoC开发工具)进行开发，无需硬件描述语言。本次Zynq7000系列开发板免费试用活动，将提供威视锐公司EagleGo-HD、EagleGo-DSP和EaglePi套件，支持Vivado、Sdk、Vivado HLS、SDSoC开发工具。
免费申请 Zynq7000:http://forum.eepw.com.cn/forumevent/v3
关键词：Xilinx V3学院杯 Zynq7000 可编程SoC 嵌入式
演讲嘉宾
- 演讲嘉宾：
- 尤恺元
- 嘉宾职务：
- FPGA培训部教育总监
- 嘉宾简介：
- 尤恺元先生，乌克兰国立航空大学电子飞行器设备系硕士研究生，从事无线通信接收机、发射机等关键技术的研发，精通图像降噪算法，音频信号信源压缩相关算法的实现，以及专网通信协议的制定。先后任职于基辅斯拉特卡电子有限公司、北京巨数数字科技有限公司、北京泰豪装备电子科技有限公司、上海威三教育科技有限公司等企业，致力于互联网接入技术、无线通信与图像信号处理、超低速率音频声码器、专网通信协议等技术的研究和商业化应用。是国内数字媒介无线电(Digital Media Radio)对讲机基带芯片的设计参与者，北斗、GPS(Global Position System)、格洛纳斯(Global Navigation Satellite System)三位一体联合导航接收机项目的重要参与者，以及正弦编码的2.4千比特每秒超低速率声码器技术实现。
在ZYNQ 7000系列芯片中完成设计红外成像系统，对使用ZYNQ系列芯片做图像处理有丰富的项目调试和设计经验。
工作经历:
2010年就职于乌克兰基辅斯拉特卡电子有限公司，职位数字逻辑设计工程师。
完成频谱分析实时显示系统设计,从天线耦合到射频板的射频信号经过射频板的下变频等处理后,再经过ADC采样送入FPGA,我负责通过对FPGA的数字逻辑编码对输入信号进行FFT运算(2048点),FPGA运算后的频点信息需要海量存储到上位PC机中,信号的传输采用了千兆以太网,运用FPGA逻辑编码完成独立的MAC层,并实现了UDP协议与上位机通信。
2011年就职于北京巨数数字科技有限公司
组织团队对DMR数字对讲机系统射频,基带,协议进行了深入的研究,根据DMR的协议标准,设计了4FSK调制解调方案,IQ调制解调,直接鉴频解调和两点调制进行了设计,其他基带的信号处理的关键技术包括码元同步,直流分量估计滤除(频偏校正),其中码元同步采用了闭环的算法即能满足实时最佳采样时刻计算又优化了运算量,可以在一定低信噪比时仍保持较低的误码率。 关于信道编码部分,编码按照标准协议进行,解码采用了一些自己的算法优化,减少了解码占用的资源。
2013年就职于北京泰豪装备科技有限公司，职位FPGA基带信号处理工程师
北斗1代接收机设计、北斗2代接收机设计、GPS接收机设计、格伦纳斯接收机设计、二阶辅助三阶载波环和码片环路的参数优化，降低多普勒值得跳动范围，通过FFT进行快速频偏估计，以及基于FFT的快速直捕算法的实现。
2014至今就职于上海威三教育科技有限公司，FPGA培训部教育总监，负责企业学员高级课程的培训工作。
奖项设置
- 奖品说明：
- 预先报名并全程参会的网友，将有10人可得到EEPW提供的智能手环。
相关资料
关于公司
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